IS42S16320B-7TL SDRAM 64 Mb Densité 166MHz Vitesse 3.3V Opération 16Mx16 Organisation LVTTL Interface Température industrielle (-40°C ~ 85°C) Package TSOP-II compact Haute fiabilité

IS42S16320B-7TL SDRAM 64 Mb Densité 166 MHz Vitesse 3.3V Opération 16Mx16 Organisation LVTTL Interface Température industrielle (-40 et degré;C ~ 85 et degré;C) Package TSOP-II compact Haute fiabilité

etnbsp;

Caractéristiques

etbull; fréquence de l'horloge: 166, 143, 133 MHz

etbull; entièrement synchrone; tous les signaux sont référencés sur un cadran positif

etbull; Banque interne pour accès à la rangée cachée/précharge

etbull; alimentation électrique

et  et  et  et  et  et  et  et  et  et  et  et  et  et  et  et  et  et  et  et  et  et  et  et  et  et  et  et  et  et  et  et  et  et   et   et   et   et   et   et   et   et   et   et   et   et   et   et   et   et   et 

etnbsp; IS42/45S16320B 3.3V etnbsp; etnbsp;3.3V

etnbsp; IS42S86400Bandnbsp; etnbsp; etnbsp; 3.3Vandnbsp; etnbsp;3.3V

etbull; interface LVTTL

etbull; longueur de rafale programmable etdash; (1, 2, 4, 8, page complète)

etbull; séquence de détonation programmable: séquentielle/intervalle

etbull; actualisation automatique (CBR)

etbull; Self Refresh

etbull; cycles de rafraîchissement de 8K tous les 16 ms (grade A2) ou 64 ms (grade Commercial, Industrial, A1)

etbull; Adresse de colonne aléatoire à chaque cycle d'horloge

etbull; latence CAS programmable (2, 3 heures)

etbull; capacité de lecture/écriture rapide et de lecture/écriture rapide

andbull; Termination de la décharge par commandes d'arrêt de décharge et de précharge

etbull; Disponible en TSOP-II à 54 broches et en W-BGA à 54 boules (x16 uniquement)

etbull; plage de température de fonctionnement:

etnbsp; Commercial: de 0 à + 70 °C

etnbsp; industriel: -40 °C à +85 °C

etnbsp; Automobile, A1: -40°C à +85°C

etnbsp; Automobile, A2: -40°C à +105°C

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Résumé

ISSIand#39;s 512Mb DRAM synchrone permet un transfert de données à grande vitesse à l'aide d'une architecture de pipeline.La SDRAM de 512 Mb est organisée comme suit:.

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Résumé du dispositif

La SDRAM de 512 Mb est une mémoire CMOS dynamique à accès aléatoire à grande vitesse conçue pour fonctionner dans les systèmes de mémoire 3.3V Vdd et 3.3V Vddq contenant 536,870configuré en interne comme une DRAM quad-bank avec une interface synchrone.217La banque de 728 bits est organisée en 8192 lignes par 1024 colonnes par 16 bits.217Les banques de 728 bits sont organisées en 8 192 lignes par 2048 colonnes par 8 bits.

La SDRAM de 512 Mb inclut un mode de rafraîchissement automatique et un mode d'économie d'énergie.Toutes les entrées et sorties sont compatibles LVTTL.

La SDRAM de 512 Mb a la capacité de faire jaillir des données de manière synchrone à un débit de données élevé avec génération automatique d'adresses de colonnes,la possibilité d'intercaler entre les banques internes pour masquer le temps de précharge et la possibilité de changer aléatoirement les adresses des colonnes à chaque cycle d'horloge pendant l'accès instantané.

Une précharge en rangée automatique initiée à la fin de la séquence de décharge est disponible avec la fonction AUTO PRECHARGE activée.Précharger une banque tout en accédant à l'une des trois autres banques cachera les cycles de précharge et fournir une transparence, à grande vitesse, opération d'accès aléatoire.

Les accès de lecture et d'écriture de la SDRAM sont orientés sur le démarrage à partir d'un emplacement sélectionné et se poursuivent pour un nombre programmé d'emplacements dans une séquence programmée.L'enregistrement d'une commande ACTIVE commence les accèsLa commande ACTIVE en conjonction avec les bits d'adresse enregistrés sont utilisés pour sélectionner la banque et la ligne à accéder (BA0, BA1 sélectionner la banque;A0-A12 sélectionnez la ligne). Les commandes READ ou WRITE en conjonction avec les bits d'adresse enregistrés sont utilisées pour sélectionner l'emplacement de la colonne de départ pour l'accès rapide.

Les longueurs de rafale de lecture ou d'écriture programmables consistent en 1, 2, 4 et 8 emplacements ou une page complète, avec une option de fin de rafale.

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Définition

Les SDRAM de 512 Mb sont des DRAM quad-bank qui fonctionnent à 3,3 V et incluent une interface synchrone (tous les signaux sont enregistrés sur le bord positif du signal d'horloge, CLK).217Les banques de 728 bits sont organisées en 8192 lignes par 1024 colonnes par 16 bits ou 8192 lignes par 2048 colonnes par 8 bits.

Les accès de lecture et d'écriture à la SDRAM sont orientés sur les rafales; les accès commencent à un emplacement sélectionné et se poursuivent pour un nombre programmé d'emplacements dans une séquence programmée.Les accès commencent par l'enregistrement d'une commande ACTIVE suivie d'une commande READ ou WRITE. Les bits d'adresse enregistrés en coïncidence avec la commande ACTIVE sont utilisés pour sélectionner la banque et la ligne à accéder (BA0 et BA1 sélectionner la banque, A0 A12 sélectionner la ligne). Les bits d'adresse A0-A9 (x16);A0 à A9, A11 (x8) enregistré en coïncidence avec la commande READ ou WRITE sont utilisés pour sélectionner l'emplacement de la colonne de départ pour l'accès rapide.

Les sections suivantes fournissent des informations détaillées sur l'initialisation de l'appareil, la définition du registre, les procédures d'enregistrement et les procédures de démarrage.les descriptions des commandes et le fonctionnement de l'appareil.

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Les informations sont fournies à la Commission.

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Le dessin

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Une marque forte:
Il s'agit notamment de l'équipement de base pour la fabrication des produits de base.